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处理器设计工程师

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重庆

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1-3年

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硕士

职位描述

RISC-V

verilog

systemverilog

CPU

岗位职责： 1. 负责RISC-V核的架构设计以及开发工作 2. 参与核的面积，功耗，性能优化工作，把握演进方向以上要求： 1. 熟练掌握verilog，systemverilog等编程语言，熟练使用仿真debug工具，综合工具 2. 熟悉ARM或者RISC-V处理核架构，有CPU核相关开发经验

王女士

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北碚区

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